基于 SCU200（Spartan UltraScale+）评估板的 FPGA 网络安全演示给出两条以太网加密路线，二者都采用 AES‑256‑GCM 认证加密、相同密钥与报文封装格式，一条是在可编程逻辑 PL 内部搭建全流水线 AES‑GCM，另一条调用 PMC 内部固化的硬化安全引擎，端口 4000 走 PL 流水线路径、端口 4001 走 PMC 硬化路径，在同一个千兆以太网链路下直接对照测试；PL 方案优势是包处理延迟极低、小包吞吐能力强，可以做到线速转发，代价是大量消耗 LUT、触发器、BRAM 等逻辑资源；PMC 硬化引擎几乎不占用 FPGA 逻辑，资源开销大幅下降，但因为要经过桥接、寄存器配置、存储转发缓冲，单包延迟明显拉高、小包吞吐上限变低；这套设计没有搭载 MicroBlaze、TCP/IP 软核，是纯 RTL 的 AXI‑Stream 流式数据通路，适合工业以太网、车载、通信前端这类低抖动硬件加密场景，工程师选型时核心就是在吞吐延迟和逻辑资源之间取舍。下面分开整理架构流程、实测性能对比、各自适用场景、开发复现步骤、设计风险点。
一、两条加密路径基础架构
整体数据流：以太网 GEM0 接收 → UDP 解析器 → AES‑256‑GCM 加密 → 报文重构 → 以太网发送，明文头部会被提取，有效载荷加密，附加 GCM 认证标签，头部作为附加认证数据 AAD 参与校验，篡改即可被检出。
- 方案 A：PL 流水线 AES‑256‑GCM
- 方案 B：PMC 硬化安全引擎
独立流式流水线，每个时钟周期处理一个 128 bit 块，独立实现完整 AES‑GCM，不需要调用芯片内置硬核；加密、标签生成全部在 PL 完成，数据通路连续流式，不需要整包缓存等待。
AES 运算由芯片内部固化硬件完成，PL 侧只做桥接、密钥加载、DMA 控制、报文缓冲、寄存器序列控制；加密核心本身不消耗逻辑，但数据必须经过事务式调度与暂存缓冲区。
二、实测数据对比表（SCU200，125MHz，千兆以太网）
| 指标 | PL 流水线 AES-GCM | PMC 硬化引擎方案 |
|---|---|---|
| 单包硬件处理延迟 | 1.304 μs（约 163 时钟） | 19.4 μs（约 2397 时钟） |
| 小包吞吐 | 约 76.7 万包 / 秒 | 约 5.2 万包 / 秒 |
| LUT 使用量 | 31618 | 707 |
| 触发器 | 4227 | 379 |
| RAMB18 | 126 | 2 |
| 特点 | 低延迟、高小包性能、资源开销巨大 | 逻辑开销极低，延迟与小包吞吐受限 |
三、两种方案适用场景清单
- PL 流水线方案适合场景
- 千兆 / 万兆线速以太网，持续大流量、小包密集业务
- 工业实时以太网、时间敏感网络，对确定性低延迟要求高
- FPGA 资源余量充足，需要独立可控的加密链路，不依赖 SoC 硬核
- 需要多通道并行加密、独立时序控制，方便做侧信道防护优化
- PMC 硬化引擎适合场景
- FPGA 资源紧张，大量逻辑要留给业务算法、信号处理
- 流量不大、对单包延迟不敏感，优先节约逻辑面积
- 高安全等级场景，依赖厂商固化安全边界、内置信任根
- 多业务并行设计，加密只是辅助功能，不希望加密吃掉大量 LUT/BRAM
四、项目复现步骤
- 拉取官方仓库，准备 Vivado 2026.1，安装 SCU200 器件定义
- 主机端部署 Python 环境、Npcap，配置静态 IP：192.0.2.1/24，板卡地址 192.0.2.2
- JTAG 连接开发板，执行脚本烧录比特流
- 启动本地仪表盘（localhost:8765），选择网卡，发送流量分别到 4000、4001 端口
- 面板读取硬件计时、包计数器，自动对照软件预言机校验密文与标签正确性
五、关键设计风险与注意事项
- PMC 的延迟瓶颈不在 AES 本身，而在桥接、寄存器编程、存储转发，不是加密算法速度问题
- 两套路径输出密文不完全一致：IV 派生与 AAD 携带路径标识，必须各自独立校验
- 硬化引擎依赖器件型号，跨系列移植难度高；PL 流水线 IP 可跨平台迁移
- 如果同时跑两条路径，端口分流逻辑要做好，避免流量互相抢占
- 安全层面：两种方案都只做载荷加密，以太网、IP、UDP 头部明文传输，适合链路侧防护，不是跨公网 VPN
六、选型决策参考
优先线速、实时、小包性能，选 PL 流水线；优先节省资源、安全根信任、流量不大，选 PMC 硬化引擎；大型系统也可以混合部署，高速端口用 PL，低速辅助通道复用硬化引擎，平衡资源和性能。
【相关 FAQ】
问题 1：FPGA 以太网加密的两种方案，PL 流水线 AES-GCM 和 PMC 硬化引擎在延迟上差距有多大？
回答 1：在 SCU200 平台实测，PL 流水线 AES-GCM 单包硬件处理延迟仅 1.304 微秒，PMC 硬化引擎为 19.4 微秒，PMC 路径处理延迟大约高出 14.7 倍，差异来自桥接、寄存器调度与整包缓冲。
问题 2：FPGA 以太网加密两种方案，PMC 硬化引擎为什么能大幅减少逻辑资源占用？
回答 2：FPGA 以太网加密 PMC 硬化方案，AES 核心本身是芯片内部固化硅电路，不在 PL 中实现，PL 只负责桥接、密钥序列控制与报文缓存，因此 LUT、触发器、BRAM 消耗远低于自行搭建的 PL 流水线 AES-GCM。
问题 3：FPGA 以太网加密两种方案，是不是 PMC 硬化引擎性能一定更差？
回答 3：FPGA 以太网加密两种方案中，PMC 硬化引擎小包吞吐、单包延迟更弱，但加密核心本身运算速度并不慢，性能短板来自事务调度、桥接和存储转发架构，适合流量不密集、资源优先的场景。
问题 4：FPGA 以太网加密两种方案，这套设计是用什么协议封装加密报文？
回答 4：这套 FPGA 以太网加密方案基于 UDP 承载，保留标准以太网、IPv4、UDP 明文头部，载荷使用 AES‑256‑GCM 加密，附带安全头与 GCM 认证标签，头部作为附加认证数据参与完整性校验。
问题 5：FPGA 以太网加密两种方案，在实际工程里怎么选择 PL 流水线还是 PMC 硬化引擎？
回答 5：FPGA 以太网加密选型，如果是线速、小包密集、低延迟工业实时链路，优先 PL 流水线；如果 FPGA 逻辑资源紧张、流量不大、需要芯片原生安全信任根，则选用 PMC 硬化安全引擎。
【参考资料】
[2026-11-08]（FPGA 网络安全设计：两种以太网加密方案）电子工程专辑
[2026-11-08]（SCU200 security 项目仓库）Bitbucket
[2026-11-08]（Spartan UltraScale+ PMC 安全引擎手册）AMD Xilinx
[2026-11-08]（AES-GCM NIST SP800-38D）NIST
[2026-11-08]（AXI-Stream 流式加密架构设计）AMD 技术白皮书
【免责声明】
本文基于电子工程专辑公开的 SCU200 实测项目整理 FPGA 以太网加密两种方案；所有延迟、资源数据是该评估板特定版本、特定时钟下实测值，更换器件、时钟频率、报文长度后指标会变化；硬化引擎能力和接口绑定芯片型号，商用落地前必须完成时序、侧信道、安全合规测试；内容仅为硬件设计参考，不直接作为产品安全认证依据；新闻与工程文档版权归属对应来源。
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希望本篇文章《FPGA 以太网加密两种实现方案PL 流水线 AES-GCM 与 PMC 硬化安全引擎对比设计》能对你有所帮助！
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本文概览：基于 SCU200（Spartan UltraScale+）评估板的 FPGA 网络安全演示给出两条以太网加密路线，二者都采用 AES‑256‑GCM 认证加密、相同密钥与报文封装格式，一条是在可编程逻辑 PL 内部搭建全流水线 AES‑GCM，另一条调用 PMC 内部固化的硬化安全引擎，端口 4000 走 PL 流水线路径、端口 4001 走 PMC 硬化路径，在同一个千兆以太网链路下直接对照测试；PL 方案优势是包处理延迟极低、小包吞吐能力强，可以做到线速转发，代价是大量消耗 LUT、触发器、BRAM 等逻辑资源；PMC 硬化引擎几乎不占用 FPGA 逻辑，资源开销大幅下降，但因为要经过桥接、寄存器配置、存储转发缓冲，单包延迟明显拉高、小包吞吐上限变低；这套设计没有搭载 MicroBlaze、TCP IP 软核，是纯 RTL 的 AXI‑Stream 流式数据通路，适合工业以太网、车载、通信前端这类低抖动硬件加密场景，工程师选型时核心就是在吞吐延迟和逻辑资源之间取舍。下面分开整理架构流程、实测性能对比、各自适用场景、开发复现步骤、设计风险点。